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*  SURELOG System Verilog Compiler/Linter  *
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[INFO :CM0023] Creating log file ./slpp_all/surelog.log.

[NOTE :CM0009] Command line argument "+vcs+flush+all" ignored.

[NOTE :CM0009] Command line argument "+warn=all" ignored.

[WARNI:CM0010] Command line argument "-sverilog" ignored.

[INFO :PP0122] Preprocessing source file "/home/alain/Surelog/src/dist/surelog/bin/../sv/builtin.sv".

[INFO :PP0122] Preprocessing source file "top.v".

[INFO :PA0201] Parsing source file "/home/alain/Surelog/src/dist/surelog/bin/../sv/builtin.sv".

LIB:  work
FILE: /home/alain/Surelog/src/dist/surelog/bin/../sv/builtin.sv
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n<> u<539> t<Subroutine_call_statement> p<540> c<538> l<83>
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n<> u<541> t<Statement> p<542> c<540> l<83>
n<> u<542> t<Statement_or_null> p<543> c<541> l<83>
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n<> u<641> t<Module_item> p<657> c<640> s<655> l<100>
n<test> u<642> t<StringConst> p<652> s<651> l<101>
n<U_test> u<643> t<StringConst> p<644> l<101>
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n<> u<647> t<Primary> p<648> c<646> l<101>
n<> u<648> t<Expression> p<649> c<647> l<101>
n<> u<649> t<Ordered_port_connection> p<650> c<648> l<101>
n<> u<650> t<List_of_port_connections> p<651> c<649> l<101>
n<> u<651> t<Hierarchical_instance> p<652> c<644> l<101>
n<> u<652> t<Module_instantiation> p<653> c<642> l<101>
n<> u<653> t<Module_or_generate_item> p<654> c<652> l<101>
n<> u<654> t<Non_port_module_item> p<655> c<653> l<101>
n<> u<655> t<Module_item> p<657> c<654> s<656> l<101>
n<> u<656> t<Endmodule> p<657> l<103>
n<> u<657> t<Module_declaration> p<658> c<562> l<91>
n<> u<658> t<Description> p<659> c<657> l<91>
n<> u<659> t<Source_text> p<660> c<272> l<5>
n<> u<660> t<Top_level_rule> l<5>
[INFO :CM0029] Using global timescale: "1ns/1ns".

[INFO :CP0300] Compilation...

[INFO :CP0303] top.v:91 Compile module "work@interface_modports".

[INFO :CP0304] top.v:5 Compile interface "work@mem_if".

[INFO :CP0303] top.v:66 Compile module "work@memory_ctrl".

[INFO :CP0303] top.v:41 Compile module "work@memory_model".

[INFO :CP0306] top.v:78 Compile program "work@test".

[INFO :CP0302] /home/alain/Surelog/src/dist/surelog/bin/../sv/builtin.sv:4 Compile class "work@mailbox".

[INFO :CP0302] /home/alain/Surelog/src/dist/surelog/bin/../sv/builtin.sv:33 Compile class "work@process".

[INFO :CP0302] /home/alain/Surelog/src/dist/surelog/bin/../sv/builtin.sv:58 Compile class "work@semaphore".

[WARNI:CP0314] top.v:78 Using programs is discouraged "work@test", programs are obsoleted by UVM.

[INFO :EL0526] Design Elaboration...

Instance tree:
[TOP] work@interface_modports work@interface_modports
[I/F] work@mem_if work@interface_modports.miff
[MOD] work@memory_ctrl work@interface_modports.U_ctrl
[MOD] work@memory_model work@interface_modports.U_model
[PRG] work@test work@interface_modports.U_test
[SCO] work@memory_model.UNNAMED work@interface_modports.U_model.UNNAMED
[SCO] work@memory_model.UNNAMED work@interface_modports.U_model.UNNAMED
[SCO] work@test.UNNAMED work@interface_modports.U_test.UNNAMED

[NOTE :EL0503] top.v:91 Top level module "work@interface_modports".

[NOTE :EL0508] Nb Top level modules: 1.

[NOTE :EL0509] Max instance depth: 2.

[NOTE :EL0510] Nb instances: 4.

[NOTE :EL0511] Nb leaf instances: 1.

[NOTE :EL0523] top.v:91 Instance "work@interface_modports".

[NOTE :EL0524] top.v:98 Interface Instance "work@interface_modports.miff".

[NOTE :EL0523] top.v:99 Instance "work@interface_modports.U_ctrl".

[NOTE :EL0523] top.v:100 Instance "work@interface_modports.U_model".

[NOTE :EL0525] top.v:101 Program Instance "work@interface_modports.U_test".

[NOTE :EL0522] top.v:49 Scope "work@interface_modports.U_model.UNNAMED".

[NOTE :EL0522] top.v:57 Scope "work@interface_modports.U_model.UNNAMED".

[NOTE :EL0522] top.v:80 Scope "work@interface_modports.U_test.UNNAMED".

[  FATAL] : 0
[  ERROR] : 0
[WARNING] : 2
[   NOTE] : 15

********************************************
*   End SURELOG SVerilog Compiler/Linter   *
********************************************

0.92user 0.01system 0:00.98elapsed 95%CPU (0avgtext+0avgdata 47056maxresident)k
7952inputs+112outputs (29major+15619minor)pagefaults 0swaps
sh: 2: -mt: not found