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*  SURELOG System Verilog Compiler/Linter  *
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[INFO :CM0023] Creating log file ./slpp_all/surelog.log.

[INFO :PP0122] Preprocessing source file "/home/alain/Surelog/src/dist/surelog/bin/../sv/builtin.sv".

1 /home/alain/Surelog/src/dist/surelog/bin/../sv/builtin.sv 1 in
[INFO :PP0122] Preprocessing source file "top.v".

1 top.v 1 in
[INFO :PA0201] Parsing source file "/home/alain/Surelog/src/dist/surelog/bin/../sv/builtin.sv".

LIB:  work
FILE: /home/alain/Surelog/src/dist/surelog/bin/../sv/builtin.sv
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n<> u<323> t<Module_item> p<325> c<322> s<324> l<6>
n<> u<324> t<Endmodule> p<325> l<45>
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n<> u<328> t<Top_level_rule> l<1>
[WARNI:PA0205] top.v:1 No timescale set for "top".

[INFO :CP0300] Compilation...

[INFO :CP0303] top.v:1 Compile module "work@top".

[INFO :CP0302] /home/alain/Surelog/src/dist/surelog/bin/../sv/builtin.sv:4 Compile class "work@mailbox".

[INFO :CP0302] /home/alain/Surelog/src/dist/surelog/bin/../sv/builtin.sv:33 Compile class "work@process".

[INFO :CP0302] /home/alain/Surelog/src/dist/surelog/bin/../sv/builtin.sv:58 Compile class "work@semaphore".

[INFO :CP0302] top.v:6 Compile class "work@top::A".

[INFO :CP0302] top.v:14 Compile class "work@top::A::B".

[INFO :CP0302] top.v:19 Compile class "work@top::A::B".

[INFO :CP0302] top.v:3 Compile class "work@top::C".

[ERROR:CP0326] top.v:8 Multiply defined parameter "F001",
               top.v:7 previous definition.

[ERROR:CP0326] top.v:8 Multiply defined parameter "F00",
               top.v:8 previous definition.

[ERROR:CP0323] top.v:12 Multiply defined typedef "ClosedCurve",
               top.v:11 previous definition.

[ERROR:CP0326] top.v:16 Multiply defined parameter "F001",
               top.v:15 previous definition.

[ERROR:CP0326] top.v:16 Multiply defined parameter "F00",
               top.v:16 previous definition.

[ERROR:CP0324] top.v:19 Multiply defined inner class "work@top::A::B",
               top.v:14 previous definition.

[ERROR:CP0325] top.v:35 Multiply defined covergroup "memory",
               top.v:27 previous definition.

[INFO :EL0526] Design Elaboration...

Instance tree:
[TOP] work@top work@top

[NOTE :EL0503] top.v:1 Top level module "work@top".

[NOTE :EL0508] Nb Top level modules: 1.

[NOTE :EL0509] Max instance depth: 1.

[NOTE :EL0510] Nb instances: 1.

[NOTE :EL0511] Nb leaf instances: 1.

[NOTE :EL0523] top.v:1 Instance "work@top".

[ERROR:CP0317] top.v:24 Undefined type "DD".

[  FATAL] : 0
[  ERROR] : 8
[WARNING] : 1
[   NOTE] : 6

********************************************
*   End SURELOG SVerilog Compiler/Linter   *
********************************************

0.36user 0.00system 0:00.37elapsed 98%CPU (0avgtext+0avgdata 40172maxresident)k
0inputs+88outputs (0major+12898minor)pagefaults 0swaps
sh: 2: -mt: not found